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VRDM-5910 50-LVC 常州市供應(yīng)

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所  在  地上海

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更新時(shí)間:2018-05-14 09:00:00瀏覽次數(shù):170次

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VRDM-5910 50-LVC

VRDM-5910 50-LVC 是Altera公司以RISC為基礎(chǔ)的可配置、可裁減軟核處理器[2]。它具有16位指令集和16/32位數(shù)據(jù)通路,通過(guò)將包括16或32位高性能處理器在內(nèi)的多種應(yīng)用模塊嵌入到通用FPGA/CPLD內(nèi),實(shí)現(xiàn)*可配置的嵌入式系統(tǒng)。

VRDM-5910 50-LVC 軟核處理器主要特性包括:高效靈活的處理器模塊,可以通過(guò)軟件配置成16位或32位的*處理單元,并可選擇不同的內(nèi)部存儲(chǔ)器大小,其zui高執(zhí)行速度可達(dá)50MHz;具有多種其它功能模塊的選擇(SDRAM控制器、 UART控制器、PCI接口模塊、LCD接口模塊、MAC接口模塊等多種功能模塊);具有完整、廉價(jià)、便捷的開(kāi)發(fā)系統(tǒng)。所有開(kāi)發(fā)(包括設(shè)計(jì)、調(diào)試)均通過(guò)軟件進(jìn)行,不再需要專門的硬件仿真器和編程器, 大大減少了開(kāi)發(fā)設(shè)備的成本。 NIOS將CPU與PLD的功能集于一身,既簡(jiǎn)化了電路板設(shè)計(jì),又不存在接口速率的瓶頸問(wèn)題,使整個(gè)系統(tǒng)在一塊芯片上就可以完成。

 3 VRDM-5910 50-LVC 硬件設(shè)計(jì) 控制器的硬件設(shè)計(jì)流程就是為了定制合適的CPU和外設(shè),在 SOPC Builder和QuartusII中完成。在這里可以靈活定制NIOS CPU的各個(gè)特性甚至指令,可以使用Altera提供的大量的IP Core來(lái)加快*開(kāi)發(fā)NIOS外設(shè)的速度,提高外設(shè)的性能,也可以使用第三方的IP Core,或者使用VHDL、Verilog來(lái)自己定制外設(shè)。 VRDM-5910 50-LVC 嵌入式工業(yè)以太網(wǎng)控制器的硬件分為三個(gè)部分:FPGA部分、存儲(chǔ)器部分和外圍元件部分如圖1所示。本文選用的是FPGA是CYCLONE EP1C6。FPGA部分是建立在FPGA上的,核心是NIOS CPU Core,我們需要在SOPC Builder中需要設(shè)計(jì)的就是FPGA部分。VRDM-5910 50-LVC 要建的NIOS系統(tǒng)包含的元件模塊有:一個(gè)NIOS CPU核;用于連接NIOS核的Avalon總線控制器,一個(gè)存放啟動(dòng)和調(diào)試程序的內(nèi)部存儲(chǔ)器Boot ROM、一個(gè)UART串行通信電路模塊(RS-232核)、一個(gè)內(nèi)部定時(shí)器和一些通用IO外圍接口模塊。為使NIOS系統(tǒng)正常工作,在FPGA外圍必須接有一個(gè)RS-232通信口、RJ45、幾個(gè)發(fā)光管和數(shù)碼管以及16M SRAM和4M Flash ROM。 

圖1 VRDM-5910 50-LVC 工業(yè)以太網(wǎng)控制器硬件結(jié)構(gòu)

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