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KC10.3-008-3-MGP-01VRS 高質(zhì)量低價

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所  在  地上海

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更新時間:2018-05-14 09:00:00瀏覽次數(shù):220次

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KC10.3-008-3-MGP-01VRS

KC10.3-008-3-MGP-01VRS中的Cache就是采用的寫直達(dá)模式(writethrough)。在寫直達(dá)模式下,數(shù)據(jù)輸出時,系統(tǒng)會把數(shù)據(jù)同時寫入高速緩沖存儲器Cache和主存中,這樣就保證了輸出時高速緩沖存儲器的*性。但該模式下,卻無法保證輸入時的高速緩沖存儲器的*性。   下面再看一下Cache的組織方式。按照主存和Cache之間的映像關(guān)系,Cache有三種組織方式。全相聯(lián)方式、直接映像方式和組相聯(lián)方式

硬件的解決方法   由于現(xiàn)在的KC10.3-008-3-MGP-01VRS嵌入式處理器,主頻越來越高,地址、數(shù)據(jù)線越來越多,所以在硬件的設(shè)計(jì)和焊接過程中應(yīng)特別注意高頻干擾的問題。因?yàn)楦哳l干擾可以引起信號的不完整性,這些不完整的信號會引起總線傳輸過程中出現(xiàn)一些壞字節(jié),所以高速PCB設(shè)計(jì)變得尤為重要。高速PCB設(shè)計(jì)中,對高速信號網(wǎng)絡(luò)的特征與走線 控制的設(shè)計(jì)技術(shù),已成為高速數(shù)字設(shè)備成功與否的關(guān)鍵。在設(shè)計(jì)中應(yīng)注意下列問題:   

① 在成本允許的條件下, PCB盡量采用多層板布線。   

② 高頻電路布線的引線采用全直線,需要轉(zhuǎn)折時,可以用45°折線或圓弧轉(zhuǎn)折。在高頻電路中,滿足這一要求可以減少高頻信號對外的發(fā)射和相互間的耦合。   

③ KC10.3-008-3-MGP-01VRS高頻電路器件引腳的引線層間的交替越少越好,過孔越少越好。據(jù)測,一個過孔可帶來約0.5 pF的分布電容,減少過孔數(shù)量能顯著提高速度。   

④ 高頻電路布線要注意信號線近距離平行走線所引入的“交叉干擾”,若無法避免平行分布,可在平行信號線的反面布置大面積“地”來減少干擾。同一層內(nèi)的平行走線幾乎無法避免,但是在相鄰的兩個層,走線的方向務(wù)必取為相互垂直。   

⑤ 每個集成電路塊的附近應(yīng)設(shè)置一個高頻退耦電容。   

⑥ KC10.3-008-3-MGP-01VRS模擬電路和數(shù)字電路部分,應(yīng)有各自獨(dú)立的地線。   

⑦ 對特別重要的信號線或局部單元實(shí)施地線包圍的措施,各類信號走線不能形成環(huán)路,地線也不能形成電流環(huán)路。   

在注意了上面的設(shè)計(jì)規(guī)則之后,制作出的PCB基本上可以滿足高速信號的要求。   

zui后,就是在焊接時要注意焊點(diǎn)一定要圓滑。因?yàn)楹更c(diǎn)的尖峰會產(chǎn)生很強(qiáng)的高頻干擾。有了上述各條規(guī)則,就保證了在信號傳輸過程中,總線上不會出現(xiàn)不必要的干擾,防止了數(shù)據(jù)不*的發(fā)生。

結(jié)語   KC10.3-008-3-MGP-01VRS嵌入式處理器已經(jīng)被廣泛應(yīng)用。本文提到的對S3C44B0X中Cache數(shù)據(jù)不*性的處理方法同樣適用于其他型號的高頻嵌入式處理器。掌握一些設(shè)計(jì)、調(diào)試的基本經(jīng)驗(yàn),可以大大提高工作效率,減小系統(tǒng)開發(fā)過程中不必要的麻煩。

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