MOORE 39SDM024DCCAN 在發(fā)送IPROG指令之前，需要對(duì)ICAP核進(jìn)行預(yù)配置。重載控制模塊在收到觸發(fā)信號(hào)后，*個(gè)時(shí)鐘周期將ICAP核的WRITE信號(hào)和CE信號(hào)置高，第二個(gè)周期將WRITE信號(hào)置底，CE信號(hào)置高，第三個(gè)周期將WRITE信號(hào)置底，CE信號(hào)也置底。接著在下面的8個(gè)時(shí)鐘周期里，將指令隊(duì)列中的控制命令逐個(gè)發(fā)出。狀態(tài)機(jī)指令流程如圖3所示。

　　MOORE 39SDM024DCCAN 在狀態(tài)機(jī)發(fā)送IPROG指令的過(guò)程中，為了保證ICAP核接收到正確的指令，每一個(gè)發(fā)送出去的命令和數(shù)據(jù)必須遵循SelectMAP數(shù)據(jù)順序。SelectMAP數(shù)據(jù)順序是將每個(gè)指令都按字節(jié)劃分，劃分后每個(gè)字節(jié)的數(shù)據(jù)都按比特位翻轉(zhuǎn)。如果為“X32”模式，則劃分為4個(gè)字節(jié)，每個(gè)字節(jié)進(jìn)行位翻轉(zhuǎn)。圖4以“X16”為例說(shuō)明Se-lectMAP數(shù)據(jù)順序。

　　當(dāng)狀態(tài)機(jī)從用戶程序接收到一個(gè)觸發(fā)條件后，會(huì)發(fā)送一系列如圖3所示的IPROG命令。Verilog編碼實(shí)現(xiàn)狀態(tài)機(jī)的過(guò)程中，必須按照?qǐng)D3給出的指令順序發(fā)送這些IPROG命令，否則無(wú)法正確的與ICAP核通信。同時(shí)這些指令都具有自己特殊的定義而且必須服從Select-MAP數(shù)據(jù)順序，否則無(wú)法通信。IPROG指令的具體定義及說(shuō)明如表1所示。

　　在上述配置指令過(guò)程中，第五步Warm Boot StartAddress Register（WBSTAR）了滿足觸發(fā)條件的比特流在SPI FLASH中的起始地址，WBSTAR被賦值的地址必須和即將配置的bit流在SPI FLASH中的物理位置相同，否則FPGA就無(wú)法從外部讀取bit流。WBSTAR被賦值的數(shù)值都是提前根據(jù)程序的要求計(jì)算好的。計(jì)算WBSTAR值的時(shí)候需要了解WBSTAR寄存器每一位的具體含義，如圖5所示。

MOORE 39SDM024DCCAN 寄存器共31位，高三位是保留位，RS［1：0］

　　兩位了可以多重配置的bit流的個(gè)數(shù)。RS_TS_B是RS［1：0］的使能信號(hào)：0表示Disabled，1表示Enabled.

　　MOORE 39SDM024DCCAN 表示要回讀的比特流在外部配置存儲(chǔ)器的起始地址。狀態(tài)機(jī)在對(duì)WBSTAR進(jìn)行賦值時(shí)，要根據(jù)自己選擇的bit流個(gè)數(shù)以及對(duì)應(yīng)各個(gè)bit流在外部配置存儲(chǔ)器貯存的地址自行計(jì)算WBSTAR地址。這里以4個(gè)bit流為例說(shuō)明WBSTAR地址的計(jì)算方法，如表2所示。狀態(tài)機(jī)使用的地址是服從SelectMAP數(shù)據(jù)順序的地址。FPGA配置邏輯在收到IPROG指令后，開始執(zhí)行內(nèi)部復(fù)位操作（JATG管角和重載控制部分不進(jìn)行復(fù)位操作），擦除板卡上原有的程序，從FLASH芯片中WBSTAR所指向的起始地址開始讀取新配置文件完成FPGA的重配置。

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